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$clog2(1)=0

项目场景:

 写ip 时, 使用参数化的方式实现2w1r 时,出现计算读返回index 时,减下溢!


问题描述

 verilog中会使用parameter 参数化,例如使用dpth 和$clog2(dpth)=addr    。 常见的写法没有什么问题。

module  A(parameter  DPRT=1024,parameter   ADDR_WDTH= $clog2(DPTH)
)(
input clk,
input rst_n,input [ADDR_WDTH-1:0]  wr_addr,……
);

但是如果不是dpth 这种变量, 而是可以从1~无穷的数据。此时$clog2(1) ==0。  出现wr_addr 的位宽就是【(0-1):0】,显然不符合设计


原因分析:

$clog(xxx)是一种向上取整的函数, $clog(3)=1.33=2 ,但是其仅左右与2~无穷的数据,对于1 需要单独处理!!!!


解决方案:

划分为 1 和2~无穷   2种情况。 

ADDR =  (DPTH==1)?1  : $clog2(DPTH);

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