fpga系列 HDL：XILINX Vivado ILA FPGA 在线逻辑分析

• ILA为内置逻辑分析仪，通过JTAG与FPGA连接，程序在真实硬件中运行，功能类似Quaruts的SignalTap II 。

ip创建ila

使用ila ip核

`timescale 1ns / 1ps
module HLSLED(input wire clk ,input wire rst_n ,output wire led);//     reg led_o_i = 1 ;//输入数据有效wire led_o_i = 0;// assign rest_n = 0;reg rst = 0;wire led_o_o_ap_vld;// (in parentheses) to your own signal names.//----------- Begin Cut here for INSTANTIATION Template ---// INST_TAG
//hlsv_0 your_instance_name (
hlsvv your_instance_name (.led_o_o_ap_vld(led_o_o_ap_vld),  // output wire led_o_o_ap_vld.ap_clk(clk),                  // input wire ap_clk.ap_rst(rst),                  // input wire ap_rst.led_o_i(led_o_i),                // input wire [0 : 0] led_o_i.led_o_o(led)                // output wire [0 : 0] led_o_o
);ila_0 your_instance_name1 (.clk(clk), // input wire clk.probe0(led), // input wire [0:0]  probe0  .probe1(your_instance_name.i_reg_61) // input wire [13:0]  probe1
);  endmodule

编译并下载程序

运行并采样数据

CG

• 注：感觉VIVADO中的DEBUG功能用起来更简单一点